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在 2 纳米及以下工艺水平，摩尔定律意味着更多，但更多也意味着更少。

表面上，在光刻胶大小的芯片上集成的晶体管越多，芯片处理数据以及在存储器和芯片之间往返传输数据的速率就越快。但表面与现实正在出现偏差。

从历史上看，收场这一方向的最好模范是缩小晶体管、导线和存储单位的尺寸。但在 2 纳米及以下制程工艺下，这种模范面对严峻挑战。导线极端细，导致 RC 蔓延成为一个首要难题。行动缓存主要技能的 SRAM 尺寸缩小，在数字逻辑电路的缩小方面远远逾期。这反过来又松手了单个光罩大小的芯片上可容纳的存储容量。此外，由于工艺偏差，在晶圆厂中收场疏导的良率也变得愈加贫穷，因为工艺偏差可能出现时数百以至数千个插入点以及制造过程中使用的数十种器具上。

任何制造工艺齐存在一定进度的偏差，但在2纳米制程中，偏差的进渡过甚成因齐在加多。由于金属层和衬底越来越薄，容易发生翘曲，导致凸点无法统统研究；此外，为确保芯片可靠性而需要的数十谈工序也可能减弱或损坏脆弱的互研究构或材料。芯片制造开采自身存在偏差，原材料和晶圆也相似如斯。其效果是，天然芯片上的晶体管和互连数目更多，但弱势率也更高。本钱上升，良率着落。

Synopsys工程副总裁 Abhijeet Chakraborty 示意：“东谈主们祈望尺寸缩小后，器件性能会更快、功耗更低、晶体管密度更高。但挑战在于能否收场这些方向。能否收场性能提高 10% 到 15%，功耗缩短 20% 到 30%？对于好多小心每瓦性能和晶体管密度的应用来说，更低的功耗极具蛊卦力。但能否作念到这一丝呢？这其中蕴含着诸多挑战和考量。履行应用中，良率和可制造性齐面对着诸多挑战。”

制造工艺是一个束缚完善的过程。跟着时刻的推移，工艺束缚矫正，使得代工场能够放宽那些为每项前沿工艺预留裕量的严格设想规矩，也使得EDA和开采供应商能够针对每项工艺制定相应的规矩和例外情况。最初，只是是让这些先进节点设想能够日常运行自身便是一项工程豪举，而早期版块经常是针对最坏情况设想的，其中包含冗余晶体管、互连线以及填塞的内置自测试功能，以便在必要时从头路由数据和处理过程。

但这种利润空间会占用正经的面积资源，松手性能和能源方面的投资答复。

“在2nm和18A工艺中，裕量已成为最受诟病的资源之一，” proteanTecs首席工夫官Evelyn Landman示意。“裕量必须足以搪塞工艺偏差、热效应和环境影响、责任负载压力、潜在弱势以及老化等问题。将整个这些成分汇总到一个单一的最坏情况保护带中已不再可行。静态保护带会放手性能和功耗，况且仍然无法对抗履行应用环境中的各式挑战。独一可捏续的模范是成功测量保护带，即在履行责任负载下，以高秘密率及时监测时序裕量，并在产物质命周期内捏续贬责。其中枢念念想是成功监测时序裕量，而不是通过盘曲模范。”

跟着工艺的练习，不错在保捏可接受良率的前提下减少裕量。但对于5nm以下的每个新节点，尤其是2nm及以下节点，收场这一方向所需的时刻越来越长。尽管16/14埃节点正在研发中，10埃（相等于1nm）节点的研发责任也已启动，但从5nm之后的每个节点驱动，达到足以得志大边界量产良率要求的量产所需的时刻齐在延长。

英特尔逻辑工夫副总裁兼总司理 Ben Sell 示意：“14A 之后，下一个攻击的制程节点是 10A。咱们仍是在研发这个节点了，但节点称号自身并不攻击，攻击的是它能否得志客户的需求。咱们经常会先详情一个基础节点。咱们会为少数几个最攻击的客户界说一个基础节点。咱们称这些客户为‘界说型客户’，节点便是凭据他们的需求来界说的。如若这个节点得志了咱们主要客户的需求，那么在与更多客户融合时，咱们可能会对这个节点进行一些修改。比如加多几层金属层，或者进行一些小的改变，以得志特定产物的需求。但这些改变幅度相对较小，因为咱们但愿确保整个已开发的 IP 齐能在芯片上使用，这么就无需从头设想仍是过考据和测试的 IP。”

10A节点很可能是临了一个摄取环栅场效应晶体管（GAA）的节点（尽管业界历来齐有将工夫推向超出预期水平的前例）。拔帜树帜的是互补型场效应晶体管（FET） ，前后可能出入一两个节点，这种晶体管勾通了在不同晶圆上开发的nFET和pFET。

“CFET 是一种器件架构，” Lam Research的首席东谈主工智能官兼 Semiverse Solutions 公司副总裁 David Fried 示意，“与 FinFET 和环栅 FET 比拟，它加多了前端的复杂性和挑战。结构愈加复杂，触及的材料也更多。这些材料之间的距离将比以往任何时候齐更近。但 CFET 的真理真理之处在于，从平面到 FinFET 再到环栅，咱们的 nFET 和 pFET 一直齐是横向相邻的。而对于 CFET 来说，它们将曲折堆叠。这带来了高大的结构复杂性，以及咱们往时从未见过的互连复杂性。举例，好多后面的电源分派必须琢磨到 nFET 和 pFET 是曲折堆叠而不是相邻的。因此，CFET 的复杂性将浸透到该工夫的好多其他方面。它不单是是晶体管的翻新。”

图 1：CFET，高傲了 nFET 和 pFET 的位置

经济场地的变化，加速了翻新

东谈主工智能数据中心的大边界建造和部署，从根柢上改变了2纳米及以下制程芯片的设想和制造花式。天然从功耗角度来看，芯片尺寸的缩小仍然被视为上风，性能方面也有一定进度的提高，但光罩尺寸的芯片上可用的空间不及以处理生成式东谈主工智能和智能东谈主工智能所需的多数数据。因此，与其试图将整个功能齐塞进单个芯片，不如将重心转向多芯片封装的芯片组，尽管称号如斯，但这些芯片组的尺寸不错与光罩尺寸疏导。

这带来了一系列新的衡量弃取。对于定制化高档封装中的多个芯片而言，面积不再是主要问题，但数据的编排和传输却变得极具挑战性。阐述东谈主工智能计较是一个复杂的、大边界并行操作，其中处理过程可能被分派到不同的处理单位，最终将效果合并。自 IBM 在 20 世纪 80 年代初度大边界并行处理以来，临了一步一直是个难题。

开头，将所少见据同期移动到正确的位置极其贫穷。任何处理单位的蔓延，或因责任负载特定的热梯度导致的一条或多条数据旅途的不均匀老化，齐可能缩短通盘系统的性能。此外，在20埃或更小的距离下，驱动芯片间长距离信号所需的电阻会加多功耗，从而导致封装里面温度升高。要津在于详情这些多芯片组件将如何诳骗特定的责任负载，因为这会影响封装里面热量的积聚位置。跟着责任负载的变化，热量也会随之改革。这会导致热门的出现，进而加速电转移，最终可能减缓以至统统阻断数据传输。

“责任负载如今已成为首要的设想敛迹要求，”proteanTecs公司的兰德曼示意。“攻击的不仅是计较量的使用，还有计较量随时刻推移的使用神气。大型言语模子锤真金不怕火和推理模式会在芯片上酿成高度不均匀的压力。即使是疏导的芯片，瞬时峰值、局部热门和万古刻的压力模式也会产生截然有异的效果。忽略责任负载举止的设想要么会过度敛迹，要么会在履行应用中显得脆弱。”

跟着芯片渐渐演变为由研究到某种中介层的小型芯片构成的蚁合体，这一丝变得尤为攻击。此外，为了使用更细的导线在更长的距离上传输更多数据，还需要进行其他方面的矫正。在起初进的工艺节点上，买球投注平台app中国官方下载需要摄取新的材料和工艺，以提高先进封装里面以及封装之间长距离传输电子（最终也包括光子）的转移率，同期还要提高结构褂讪性，并减少2.5D和3.5D结构中的翘曲。

“从高介电常数材料和金属栅极到用于应力源的硅锗，材料翻新层见错出，”Lam Research 的 Fried 说。 “跟着先进逻辑晶体管的发展，咱们简陋每十年就会看到几项材料翻新。在我现时的责任中——我触及逻辑器件、DRAM、NAND、好多不同的专科阛阓以及先进封装——这种翻新是捏续束缚的。从钨到钼的过渡仍是在NAND和DRAM字线以及底层逻辑互连中发生。从钴到钌的过渡似乎还要过一段时刻，但咱们将在底层互连和布线等特定领域看到它的应用。你不错不雅察任何一项材料过渡，并发现它在多个不同工夫领域——逻辑、DRAM和专科先进封装——的交织点。这些过渡正在各个领域发生。专科工夫领域令东谈主无比旺盛。举例集成光子学。咱们酌量集成光子学仍是很深刻，但这些大型东谈主工智能系统着实鼓吹了东谈主们对集成光子学的更多关心。集成光子学的材料遴荐可能极端复杂，因此该领域将会出现材料过渡。”

在这么的尺寸下，边界经济和可重迭性变得愈发攻击。从2008年驱动，芯片行业入部下手将晶圆尺寸从300毫米过渡到450毫米，以期在一派晶圆上制造更多芯片，从而对消束缚飞腾的研发本钱。关联词，由于其时能够从450毫米晶圆中获益的公司数目不及，这项贪图于2017年被遗弃。

自那时以来，阛阓仍是发生了变化。现时有四家当先的晶圆厂——英特尔晶圆厂、台积电晶圆厂、三星晶圆厂，以及新加入的Rapidus晶圆厂——同期，由于东谈主工智能的发展，东谈主们对更高性能的需求也永无荒谬。

只是提高时钟频率已不再可行，因为这会焚烧芯片，因此业界遴荐了摄取多芯片决策，即芯片组（chiplet）。制造整个这些芯片组最经济的模范是使用大型矩形面板，而不是300毫米圆形晶圆。这与转向450毫米晶圆的旨趣疏导，只是体式和尺寸不同，况且行动被迫基板。矩形尺寸比圆形晶圆能容纳更多的芯片，而且工艺更容易圭臬化，而无需像从大型圆形晶圆中榨取更多可用面积那样贫穷。英特尔实验室以至建议了面板级芯片决策，该决策基本上是将Cerebras开发的晶圆级决策扩展到500 x 500毫米的全尺寸面板上。

关联词，这种变化的幅度令东谈主远而避之。它需要全新的开采和不同的薄晶圆处理模范，这绝非易事。此外，由于机械应力，最大偏差区域也从晶圆边际改革到了面板中心。

Rapidus封装工夫现场首席工夫官Rozalia Beica示意：“圆形晶圆仍将是初期阶段，更多地应用于2.5D硅中介层。但即便如斯，由于光罩尺寸的松手，业界也已驱动转向面板封装。面板封装的产能将更高。这履行上取决于中介层的尺寸以及咱们将要坐褥的封装类型，但咱们将在归并家晶圆厂完成封装和硅芯片的制造。咱们无需将芯片运载到其他晶圆厂或其他国度进行封装。”搀杂键合工夫也正在蕃昌发展。Beica补充谈：“这些芯片将摄取晶圆级封装（DUIW）。晶圆级封装更相宜搀杂存储器，但当器件尺寸不同期，晶圆级封装（DUIW）会更合适——但也更具挑战性。”

图 2：芯片封装结构的演变

更丰富的定制化决策

鼓吹了先进制程节点的发展，其背后是财力淳朴的公司同意投资定制硅芯片以得志其特定需乞降数据类型。Rapidus 的晶圆级芯片 (DIO) 和面板级芯片 (DIO) 工夫收场了卓越 2nm 电子传输通谈的定制化。与此同期，英特尔晶圆代工 (Intel Foundry) 将该传输通谈集成到基层金属层中，然后提供迥殊的金属层以供定制，以及各式互连神气，举例桥接。台积电 (TSMC) 则通过其名为 NanoFlex 的工夫，在其圭臬单位架构中提供纯真性。三星贪图提供一种定制的 HBM，从不同的角度提高性能。最终，每家晶圆代工场齐会找到最相宜我方的决策，很可能是多种模范的组合。

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“通用平台将会存在，但专门旨的定制化仍将保留，”proteanTecs公司的兰德曼示意。“不同的阛阓疼爱不同的衡量弃取。跟着定制化进度的提高，设想意图、芯片履行情况、封装性能和系统运行之间快速关联的需求变得至关攻击。恰是这种响应轮回使得先进工艺节点能够卓越早期摄取者，收场边界化应用。”

高速地对数据进行优先级排序、分类和传输至关攻击。在平面SoC中，从芯片一角向另一角发送信号仍然比通过中介层将信号传输到芯片外更快。事实上，在先进封装中收场肖似速率的独一模范是使用全3D集成电路，这种集成电路不错进行布局有贪图，使要津数据需要传输的距离比平面SoC更短。现时，这种模范已应用于HBM存储器堆栈下方的逻辑层，但DRAM堆栈能否达到或接近SRAM的速率还有待不雅察。此外，由于散热和偏差联系的问题，全3D集成电路在其他应用中是否具有本钱效益也尚不解确。

光子学能够能提供一个可行的过渡决策。近期对于将光波导镶嵌玻璃基板的酌量标明，这种模范不错显赫加速数据传输速率，且产生的迥殊热量极少。其面对的挑战包括：如何督察玻璃开裂、如安在短促空间内将光信号休养为电信号，以及如何搪塞热致光漂移。值得侥幸的是，好多玻璃和硅的热彭胀所有大致疏导。

光学工夫在多个领域发挥着越来越攻击的作用。掩模写入工夫的越过使得在晶圆上印刷各式体式（包括多边形和弧线体式）的精度大大提高。

英特尔的塞尔示意：“咱们正在极端仔细地研究弧线体式。这是一种衡量，因为计较这些弧线体式的本钱更高，但精度也更高。是以这取决于你需要多高的精度，因为微调也需要迥殊的本钱。”

另一种遴荐是高数值孔径（NA）的极紫外（EUV）光刻工夫。“Intel 18A 的设想允许咱们使用单次 EUV 光刻，这极端棒，”Sell 说。“但预测将来，咱们将不得不摄取屡次 EUV 光刻，而这恰是用单次高 NA EUV 光刻替代屡次低 NA EUV 光刻的契机地方。咱们现时正在 Intel 14A 上进行这方面的研究。咱们仍是制定了设想规矩，以便能够同期使用这两种工夫。但跟着时刻的推移，如若能够用单次高 NA 光刻替代低 NA EUV，就能简化工艺过程并缩短本钱。咱们对 14A 的各式决策捏绽放魄力。咱们知谈低 NA EUV 光刻也能收场。而高 NA EUV 光刻则提供了缩短本钱的契机。”

另一种遴荐是在多芯片组件中组合不同类型的单位，这不错进一步缩短本钱。“IP是设想的要津构成部分，天然，IP是针对特定工夫节点（举例2纳米）进行优化的，”Synopsys公司的Chakraborty示意。“因此，通过这种搀杂设想理念，您不错搀杂搭配不同的圭臬单位。您不错将高性能圭臬单位与低功耗圭臬单位以及高密度圭臬单位搀杂使用。现时有更多类型的圭臬单位可供遴荐，而器具必须极端智能地遴荐它们，才能最大限定地发挥其上风。如若您为特出志高性能计较AI设想中极端高的性能方向而到处使用高性能圭臬单位，那么您将付出功耗和其他主义方面的代价。但这种搀杂使用极端攻击。”

论断

组件的混搭组合将重心从缩极少字逻辑尺寸改革到数据传输。所谓的“卓越摩尔定律”设想是收场东谈主工智能/高性能计较数据中心以及将来高性能边际计较性能方向的独一阶梯。在许厚情况下，它们还能加速产物上市速率，因为它们诳骗了半导体制造领域数十年的训戒积存。

“咱们仍然会摄取平面加工工艺，”弗里德说谈。“咱们仍然会将晶圆放入开采中，处理晶圆上涌现的整个内容。每个工艺齐有其参数、变异性和联系的测量工夫。这些齐会浸透到你构建的任何结构中。工艺、参数和要津性能主义齐会更多。然则，相识这些变异性如何浸透到工夫中、它们如何互相作用、以及在那边需要限度它们的基本数学旨趣并莫得改变。数学计较量照实加多了，但实质上并莫得改变。当工夫还比较简陋的时候，咱们知谈这些数学旨趣，况且咱们进行了整个这些计较。咱们最初是在脑海中进行计较，然后咱们开发了一些相对简陋的系统来收场这些计较。但现时工艺和参数如斯之多，咱们必须使用先进的系统，以及复古这些系统的物理模子或诬捏硅，才能理清整个这些数学计较。”

（来源：编译自semiengineering ）

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